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Principal Engineer - FPGA/ASIC Design | 5 year(s) | Senior | IC
Principalremotehace 3 d
Análisis del mercado
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🟥 Principal Engineer - FPGA/ASIC Design | 5 year(s) | Senior | IC
- ️ Rolls-Royce | Aerospace
- ️ United States of America
Remote 📡 Required languages: 🇬🇧
Skills: verilog, systemverilog, python, tcl, git, matlab Tags: #red #research_and_development #remote #embedded
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